イーソルは、株式会社ユーリカ、京都マイクロコンピュータ株式会社、株式会社エヌエスアイテクスと共同で、国立研究開発法人新エネルギー・産業技術総合開発機構(以下NEDO)により「高効率・高速処理を可能とするAIチップ・次世代コンピューティングの技術開発事業/革新的AIエッジコンピューティング技術の開発」の開発テーマの一つとして2020年7月に採択された「セキュアオープンアーキテクチャ基盤技術とそのAIエッジ応用研究開発」の委託事業(以下本事業)への取り組みを開始します。
本事業は、既存のRISC-V開発環境に対して国内活用の観点で不足しているOSや開発ツール面での機能を開発すると共にRISC-Vの標準への採用を働きかけ、世界的なオープンアーキテクチャの普及促進を図ります。また、本プロジェクトを国内の有力組込みツールベンダを中心に推進することにより、急成長が見込まれるオープンなプロセッサIPであるRISC-Vの国内ベンダエコシステムの確立を目指します。

本事業では、現存するRISC-Vの開発環境をベースに、ユーザから必要とされている要件を成立させるために現在不足しているOSや開発ツールの開発と実証評価を行います。特に組込みシステムで競争力を発揮するために重要となる処理効率・リアルタイム性を確保することを重視しています。プロジェクト終了後には各企業によりサポートを含むビジネスを展開することで、国内外の組込みシステムを開発する機器メーカー等におけるRISC-Vの利活用を強力に支援していきます。

イーソルは、組込みシステムに必要とされかつRISC-Vの標準・環境で不足しているRISC-Vに最適化されたマルチコア対応の高性能RTE*[1] (OS)の設計・開発を行い、さらに、イーソルの並列化支援ツールであるeMBP(r)のRISC-V対応開発を行っていきます。具体的にはイーソルがチェアを務めるIEEE Std. 2804で標準化しているSHIM*[2] XML*[3] のRISC-V版の開発を行い、このRISC-V SHIM XMLをRISC-Vのオープンソースコミュニティに公開することで、標準化の普及を促進していきます。

ユーリカは、セキュアオープンアーキテクチャに対応したRTEのオープンソース化の実証ならびにPOC*[4] システムとしてFPGA*[5] を想定した対応評価環境を設計・開発します。また、組込み用途向けスレッドライブラリの研究・開発を実施します。さらにRISC-Vのオープンコミュニティの育成支援を積極的に行うと共に、RTEのオープンソース化によるコミュニティの運営を目指します。

京都マイクロコンピュータは、RTEに対応する、ベクトル化を含むC言語コンパイラ及びツールチェインの研究・開発を行います。コンパイラはLLVM/Clangをベースとし、RTEと連携できる実行時バグ検出機能を実装します。これらの研究・開発により並列化プログラミングの開発効率の向上を目指します。また、これらの研究開発を通してRISC-Vコミュニティの発展に貢献していきます。

エヌエスアイテクスは、マルチコアRISC-Vシステムで必要とされる並列プログラミング環境の開発を行います。具体的には、既存ソフトウェア資産の移行性確保の手段としてOpenMPベースのディレクティブプログラミング環境、及びニューラルネットワークや自動運転等の新しいアプリケーションソフトウェア開発のためにOpenCL, SYCL処理系を実装します。本研究開発を通じて得られた知見を標準規格に採り入れる活動を通じて、RISC-Vコミュニティの発展に貢献していきます。

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*[1] RTE : Runtime Environment(ランタイム環境)の略称
*[2] SHIM : Software-Hardware Interface for Multi-many-core(マルチコア、メニーコア環境向け構造記述仕様)の略
*[3] XML : Extensible Markup Language(拡張可能なマークアップ言語)の略称
*[4] POC : Proof of Concept(概念実証)の略称
*[5] FPGA : Field Programmable Gate Array(現場でプログラム可能なゲートアレイ)の略称
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<補足資料>
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* イーソル、イーソル株式会社、eSOL、eMBPは、イーソル株式会社の日本及びその他の国における登録商標または商標です。
* エヌエスアイテクス、株式会社エヌエスアイテクス、NSITEXは、株式会社エヌエスアイテクスの日本及びその他の国における登録商標または商標です。
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